ARM Cortex-M 嵌入式驱动与固件开发专家指南

旨在解决嵌入式开发中常见的底层硬件适配、实时性中断优化以及 Cortex-M7 等高级内核的内存一致性问题，提供可编译的专业级驱动模块和架构方案。

为什么需要这个技能

嵌入式开发不仅仅是调用 API，更涉及对硬件寄存器、内存映射（MMIO）和时序的精确控制。尤其在面对高性能的 Cortex-M7 内核（如 Teensy 4.x 或 STM32 H7）时，由于引入了数据缓存（D-Cache）和弱内存顺序（Weakly-Ordered Memory），开发者常遇到“调试打印时正常，去掉后失效”的诡异 Bug。

本技能让 AI 能够以资深嵌入式工程师的视角，提供包含内存屏障（Memory Barrier）、DMA 缓存一致性处理以及严格中断优先级管理的工业级代码，避免由于内存对齐或竞争条件导致的系统崩溃。

适用场景

• 底层驱动实现：为 I²C, SPI, UART, ADC 等外设编写裸机（Bare-metal）或基于 HAL 层的驱动。
• 性能极限优化：利用 DMA 传输、TCM（紧耦合内存）和中断优先级组（Priority Grouping）提升实时性能。
• 复杂架构设计：设计基于 FreeRTOS 或 Zephyr 的多任务调度方案，实现非阻塞的 API 接口。
• 疑难 Bug 诊断：分析 HardFault 状态寄存器，定位内存对齐错误或非法指令访问。

核心工作流

1. 需求对齐：明确目标平台（如 STM32F4 vs H7）、外设协议参数（速率、模式、数据包大小）。
2. 驱动骨架设计：定义配置结构体、寄存器映射及编译时常量，确保模块化。
3. 核心实现：编写初始化序列 实现 ISR 中断处理 构建用户层非阻塞 API。
4. 安全性增强：
   • M7 特有处理：插入 __DMB()/__DSB() 屏障，确保 MMIO 写入生效。
   • DMA 维护：确保缓冲区 32 字节对齐，并执行必要的 Cache Flush/Invalidate 操作。
5. 验证与迭代：提供完整示例代码，标注时序约束与吞吐量预期，根据硬件反馈微调。

下载和安装

下载 arm-cortex-expert 中文版 Skill ZIP

解压后将目录放入你的 AI 工具 skills 文件夹，重启工具后即可使用。具体路径参考内附的 USAGE.zh.md。

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